ZEM5305開發(fā)板美國OPAL KELLY ZEM5305

普索貿易

1、所有產品直接通過德國*采購，歐元交易享受歐盟區(qū)域特殊折扣。

2、所有產品100％*，原廠Packing List、Invoice、原廠證明、原產地證明、德國香港海關關単手續(xù)齊全。

3、歐盟境內5000余家供應商，包含施耐德、菲尼克斯等3000多個工控自動化品牌，500多份原廠提供價格表迅速報價。

4、每周法蘭克福-香港空運專線，香港-深圳72小時清關，貨期優(yōu)勢較北京、上海等更加快速靈活。

5、公司內部無紙化ERP辦公，詢報價處理及時快速！

由于產品型號眾多，網上表述不全，如需型號確認或；我們將以認真負責的態(tài)度、周到細致的服務處理您的每一次來電。

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Opal Kelly  ZEM5305-A2 是一款基于 Altera Cyclone VE FPGA 的 FPGA 集成模塊，具有 25,000 個邏輯元件、25 個 DSP 模塊和 50 個 18×18 乘法器。除了高門數(shù) FPGA 之外，ZEM5305 還利用USB 3.0的高傳輸速率  進行配置下載和前面板通信，實現(xiàn)了對 FPGA 的幾乎即時重新編程和 340+ MB/s 的 FPGA 和 PC 之間的傳輸。

_clkp“CLOCK_DEDICATED_ROUTE = FALSE;>
我讀了這個帖子，但我不知道這是不是正確的方法。
當我將此路徑添加到ucf文件時，我可以使用FPGA編輯器，但Place＆amp; Route仍然是錯誤的。板的LVDS 100MHz時鐘連接到GCLK 28/29（AB11，Y11-ug382）。
LVDS時鐘進入全局時鐘引腳對并擊中IBUFGDS。
該緩沖器的輸出轉到BUFIO2，其DIVCLK輸出轉到PLL的CLKIN。

Opal Kelly 的 FrontPanel SDK 是一個易于使用、強大的 API，用于與您的 PC、Mac 或 Linux 硬件進行通信、配置和接口。FrontPanel 處理您的軟件和 FPGA 內部構件之間的所有交互，顯著減少與設計接口所需的時間和精力。

原型設計和 OEM 集成

Opal Kelly FPGA 集成模塊旨在成為原型和 OEM 產品集成的理想統(tǒng)包解決方案。借助完整的 FrontPanel SDK，沒有任何更快、更可靠、生產就緒的方式來快速啟動您的 FPGA 設計。

512 MiB DDR3 SDRAM

集成的 512 字節(jié) DDR3 為高性能應用程序提供了豐富的板載內存，包括圖像捕獲和數(shù)據(jù)采集。

超高速 USB 3.0

FrontPanel 固件使設備成為支持超過 340 MiB/s 傳輸速率的 SuperSpeed USB 3.0 外圍設備。

只需增加電源

電源從您的外圍設備外部提供，以減小尺寸和成本。這也消除了噪聲敏感應用的開關電源。

94+ 外部 I/O 引腳

兩個夾層連接器上提供大量 I/O，用于與外部外圍設備集成，包括訪問三個 VCCO 組電壓。

使用此配置，我在MAP過程中出錯：
錯誤：地點：1115  - 無法安排的位置！
時鐘IOB / BUFIO時鐘組件
已找到的對未放置在可路由的時鐘IOB / BUFIO站點
對。
時鐘IOB組件放置在現(xiàn)場。
BUFIO
組件放置在現(xiàn)場。

特性和規(guī)格

64 毫米 x 42 毫米 x 6.81 毫米 (2.52" x 1.65" x 0.27")

緊湊型 Micro-B USB 3.0 連接器

Altera Cyclone V FPGA (5CEFA2U19)

用于配置和控制的 SuperSpeed USB 3.0 接口

前面板固件

512 MiB DDR3 SDRAM

16-MiB SPI 閃存，15 MiB 可用于 FPGA 配置啟動或其他存儲

可配置的啟動選項：閃存或 USB

兩個 80 針 0.8 毫米板對板連接器 (Samtec BSE-040)

94 個用戶 I/O，包括 2 個可用的 GCLK 引腳

100 MHz 低抖動時鐘振蕩器

四個 LED

獨立訪問三個 VCCO 組電壓

JTAG 引腳可通過擴展連接器使用

完整的前面板 SDK 支持

使用 C、C++、C#、Ruby、Python 和 Java 編寫的完整應用程序程序員接口 (API)。